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Study of parallelism between memory accesses for multi-banked cache architectures
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Loiselle, Igor
[UCL]
Delavallée, Thibault
[UCL]
Manet, Philippe
[UCL]
Vandierendonck, Hans
[]
Legat, Jean-Didier
[UCL]
| Document type | Communication à un colloque (Conference Paper) – Présentation orale avec comité de sélection |
|---|---|
| Publication date | 2006 |
| Language | Anglais |
| Conference | "ACES'06, Architecture & Compilers for Embedded Systems", Ter Elst, Edegem (Belgium) (du 03/10/2006 au 04/10/2006) |
| Peer reviewed | yes |
| Affiliation | UCL - FSA/ELEC - Département d'électricité |
| Links |
| Bibliographic reference | Loiselle, Igor ; Delavallée, Thibault ; Manet, Philippe ; Vandierendonck, Hans ; Legat, Jean-Didier. Study of parallelism between memory accesses for multi-banked cache architectures.ACES'06, Architecture & Compilers for Embedded Systems (Ter Elst, Edegem (Belgium), du 03/10/2006 au 04/10/2006). |
|---|---|
| Permanent URL | http://hdl.handle.net/2078.1/91613 |